Automatic Layout Synthesis Based Performance Optimization - LIRMM - Laboratoire d’Informatique, de Robotique et de Microélectronique de Montpellier

Documentation
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Communication Dans Un Congrès Année : 2004

Automatic Layout Synthesis Based Performance Optimization

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1
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Alexis Landrault

Fonction : Auteur

Laboratoire d'Informatique de Robotique et de Microélectronique de Montpellier

Nadine Azemard

Fonction : Auteur
PersonId : 20666
IdHAL : nadine-azemard
IdRef : 068448813

Conception et Test de Systèmes MICroélectroniques

Philippe Maurine

Fonction : Auteur
PersonId : 22073
IdHAL : philippe-maurine
ORCID : 0000-0002-9706-5710
IdRef : 144880717

Conception et Test de Systèmes MICroélectroniques

Michel Robert

Fonction : Auteur
PersonId : 938334
IdHAL : michel-robert
ORCID : 0000-0002-5075-2898

Conception et Test de Systèmes MICroélectroniques

Daniel Auvergne

Fonction : Auteur
PersonId : 835730

Laboratoire d'Informatique de Robotique et de Microélectronique de Montpellier

Domaines

Micro et nanotechnologies/Microélectronique

Christine Carvalho De Matos : Connectez-vous pour contacter le contributeur

https://hal-lirmm.ccsd.cnrs.fr/lirmm-00108654

Soumis le : lundi 23 octobre 2006-08:52:40

Dernière modification le : vendredi 24 mars 2023-14:52:48

Dates et versions

lirmm-00108654 , version 1 (23-10-2006)

Identifiants

HAL Id : lirmm-00108654 , version 1

Citer

Alexis Landrault, Nadine Azemard, Philippe Maurine, Michel Robert, Daniel Auvergne. Automatic Layout Synthesis Based Performance Optimization. IWLS: International Workshop on Logic Synthesis, Jun 2004, Temecula, CA, United States. pp.80-85. ⟨lirmm-00108654⟩

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