Metric Definition for Circuit Speed Optimization - LIRMM - Laboratoire d’Informatique, de Robotique et de Microélectronique de Montpellier Accéder directement au contenu
Communication Dans Un Congrès Année : 2003
Fichier non déposé

Dates et versions

lirmm-00269568 , version 1 (03-04-2008)

Identifiants

  • HAL Id : lirmm-00269568 , version 1

Citer

Xavier Michel, Alexandre Verle, Nadine Azemard, Philippe Maurine, Daniel Auvergne. Metric Definition for Circuit Speed Optimization. PATMOS: Power And Timing Modeling, Optimization and Simulation, Sep 2003, Turin, Italy. pp.451-460. ⟨lirmm-00269568⟩
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