Logical Effort Model Extension to Propagation Delay Representation

Mots-clés : Timing Analysis Modeling
Type de document :
Article dans une revue
IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, IEEE, 2006, 25 (9), pp.1677-1684
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Contributeur : Martine Peridier <>
Soumis le : vendredi 6 octobre 2006 - 11:51:34
Dernière modification le : mercredi 17 octobre 2018 - 17:20:02

Identifiants

  • HAL Id : lirmm-00104315, version 1

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Citation

Benoit Lasbouygues, S. Engels, R. Wilson, Philippe Maurine, Nadine Azemard, et al.. Logical Effort Model Extension to Propagation Delay Representation. IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, IEEE, 2006, 25 (9), pp.1677-1684. 〈lirmm-00104315〉

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