Design and Sizing of Tapered Buffers for Minimum Power-Delay Product

Type de document :
Communication dans un congrès
PATMOS'95: Fifth International Workshop on Power and Timing Modelling, Optimization and Simulation, Oct 1995, Oldenburg, Allemagne, pp.79-90, 1995
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Contributeur : Nadine Azemard <>
Soumis le : mercredi 6 février 2008 - 11:37:25
Dernière modification le : jeudi 11 janvier 2018 - 06:27:18

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  • HAL Id : lirmm-00241366, version 1

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Citation

Sandra Turgis, Nadine Azemard, Daniel Auvergne. Design and Sizing of Tapered Buffers for Minimum Power-Delay Product. PATMOS'95: Fifth International Workshop on Power and Timing Modelling, Optimization and Simulation, Oct 1995, Oldenburg, Allemagne, pp.79-90, 1995. 〈lirmm-00241366〉

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