Silicon integration of a recursive architecture for the 2-D wavelet transform
Intégration d'une Architecture Récursive sur Silicium pour la Transformée en Ondelettes 2D
Résumé
This paper introduces the mathematical formalism of the wavelet transform. We present the orthogonal and bior- thogonal wavelets, and the filter banks based signal processing. We point out the lifting scheme technique and compare it to the filter banks method, and show the advantages in terms of hardware implementation offered by the lifting scheme, compared to classical filter banks based architectures. We then review the different types of architectures for the wavelet transform found in the literature, and present an efficient architecture for the 2D wavelet transform using lifting scheme techniques. The extension of this architecture for the multiresolution decomposition is then described. The proposed architecture allows the real-time processing of images, and only needs a minimal silicon area. This architecture is suitable for embedded image processing system on chip, for video coding and compression.
Ce papier introduit brièvement le formalisme mathématique de la transformée en ondelettes. Nous abordons ensuite les notions d’ondelettes orthogonales et bi-orthogonales, ainsi que le traitement par bancs de filtres. Nous présentons plus particulièrement la technique du lifting scheme que nous comparons ensuite avec la technique des bancs de filtres, et soulignons les avantages en termes d’implantation matérielle qu’apporte le lifting scheme par rapport à des architectures classiques reposant sur les bancs de filtres. Nous rappelons ensuite les différents types d’architectures proposées dans la littérature pour la transformée en ondelettes, puis présentons une archi- tecture efficace pour la transformée en ondelettes 2D exploitant la technique du lifting scheme. L’extension de l’architecture proposée pour la décomposition multirésolution est ensuite décrite, puis nous concluons sur les résultats obtenus et les perspectives de ce travail. L’architecture proposée autorise le traitement temps-réel des images, tout en nécessitant une surface silicium minime.
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