A Reliable Architecture for Substitution Boxes in Integrated Cryptographic

Giorgio Di Natale 1 Marie-Lise Flottes 1 Bruno Rouzeyre 1
1 SysMIC - Conception et Test de Systèmes MICroélectroniques
LIRMM - Laboratoire d'Informatique de Robotique et de Microélectronique de Montpellier
Abstract : In this paper we propose an on-line self-test architecture for hardware implementations of Advanced Encryption Standard (AES). The solution assumes a parallel architecture and exploits the inherent spatial replications of this implementation. Because Substitution boxes (S-Box) represent the largest hardware in this architecture, we focus on faults affecting these S-Boxes and propose a trade-off between hardware overhead and fault latency. We show that our solution is very effective for on-line fault detection while keeping the area overhead very low. Moreover, it does not weak the device with respect to side-channel attacks based on power analysis.
Keywords : AES SBox On-Line BIST
Type de document :
Communication dans un congrès
DCIS'08: Conference on Design of Circuits and Integrated Systems, Nov 2008, CD-ROM, pp.27-32, 2008
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Contributeur : Giorgio Di Natale <>
Soumis le : mardi 24 février 2009 - 14:24:00
Dernière modification le : jeudi 11 janvier 2018 - 06:27:19
Document(s) archivé(s) le : mardi 8 juin 2010 - 19:14:22

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Giorgio Di Natale, Marie-Lise Flottes, Bruno Rouzeyre. A Reliable Architecture for Substitution Boxes in Integrated Cryptographic. DCIS'08: Conference on Design of Circuits and Integrated Systems, Nov 2008, CD-ROM, pp.27-32, 2008. 〈lirmm-00363783〉

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