Automatic Layout Synthesis Based Performance Optimization

Alexis Landrault 1 Nadine Azemard 2 Philippe Maurine 2 Michel Robert 2 Daniel Auvergne 1
1 LIRMM - Laboratoire d'Informatique de Robotique et de Microélectronique de Montpellier
2 SysMIC - Conception et Test de Systèmes MICroélectroniques
LIRMM - Laboratoire d'Informatique de Robotique et de Microélectronique de Montpellier
Type de document :
Communication dans un congrès
IWLS'04: 13th IEEE International Workshop on Logic Synthesis, Jun 2004, Temecula, CA, pp.80-85, 2004
Liste complète des métadonnées
https://hal-lirmm.ccsd.cnrs.fr/lirmm-00108654
Contributeur : Christine Carvalho de Matos <>
Soumis le : lundi 23 octobre 2006 - 08:52:40
Dernière modification le : lundi 16 juillet 2018 - 11:08:13

Identifiants

  • HAL Id : lirmm-00108654, version 1

Collections

SYSMIC | LIRMM | LIRMM_MIC | MIC | MIPS | UNIV-MONTPELLIER

Citation

Alexis Landrault, Nadine Azemard, Philippe Maurine, Michel Robert, Daniel Auvergne. Automatic Layout Synthesis Based Performance Optimization. IWLS'04: 13th IEEE International Workshop on Logic Synthesis, Jun 2004, Temecula, CA, pp.80-85, 2004. 〈lirmm-00108654〉

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